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教你如何計(jì)算OC門(mén)和OD門(mén)上拉電阻阻值?
發(fā)布時(shí)間:2015-04-09 責(zé)任編輯:sherry
【導(dǎo)讀】電阻值的計(jì)算,我們?cè)诟咧袝r(shí)期就會(huì)了,那么上拉電阻阻值的計(jì)算是怎么樣的呢?下面由小編為您介紹OC門(mén)和OD門(mén)上拉電阻阻值的計(jì)算技巧。
首先來(lái)看一下什么是OC門(mén)和OD門(mén),OC門(mén)是集電極開(kāi)路(Open Collector Gate)集成TTL門(mén)電路,即TTL門(mén)電路的一種,顧名思義,其集成電路內(nèi)部輸出管的集電極開(kāi)路。在使用中門(mén)電路的輸出端必須經(jīng)上拉電阻接另一電源電壓。通過(guò)調(diào)節(jié)數(shù)值或上拉電阻阻值,可以改變輸出端輸出的高電平的數(shù)值或輸出的驅(qū)動(dòng)電流值。這就是OC門(mén)與普通TTL門(mén)電路的主要區(qū)別。除此,兩個(gè)以上OC門(mén)的輸出端可以并聯(lián),而普通TTL門(mén)電路輸出端不能隨便并聯(lián)。OD門(mén)是漏極開(kāi)路(()pen Drain Collector Gate)集成CMOS門(mén)電路。它的特性和使用情況與OC完全相同。
在單個(gè)OC(或OD)門(mén)的使用中,單個(gè)OC(或OD)門(mén)電路的輸出端與外接電源之間需接上拉電阻R,否則輸出端無(wú)高、低電平。在輸入信號(hào)作用下,當(dāng)門(mén)電路內(nèi)部輸出管飽和時(shí),通過(guò)電阻R的電流是內(nèi)部管的飽和電流。減去內(nèi)部管的飽和電流在電阻R上的壓降就是輸出端y的低電平輸出電壓值。在信號(hào)作用下,當(dāng)內(nèi)部輸出管截止時(shí),通過(guò)電阻R的電流是內(nèi)部管的截止電流。減去內(nèi)部管的截止電流在電阻R上的壓降,就是輸出端y的高電平輸出電壓值。如果輸出端外接負(fù)載.電阻上的壓降還要考慮負(fù)載電流,而負(fù)載電流的方向和大小由輸入特性決定。這就是計(jì)算電路中電阻阻值的技巧。
另外,上拉電阻在多個(gè)OC或(或OD)門(mén)的使用中,也有一定的計(jì)算機(jī)巧,多個(gè)OC或(或OD)門(mén)的輸出端并聯(lián),共用一個(gè)上拉電阻,否則輸出端無(wú)高、低電平。這種連接叫“線與”。
Y=Y1·Y2·...·Yn,可見(jiàn),Y1,Y2,...Yn,中只要有一個(gè)以上為低電平時(shí),y就為低電平;而只有Y1,Y2,?,Yl均為高電時(shí),Y才為高電平。在輸入信號(hào)作用下Y為低電平時(shí)。根據(jù)Y1,Y2,?,Yn的輸出情況,所有輸出低電平的集成電路內(nèi)部輸出管的飽和電流決定電阻R上的壓降。Vcc減去內(nèi)部管的總飽和電流在電阻R上的壓降就是輸出端y的低電平輸出電壓值。在輸入信號(hào)作用下Y為高電平時(shí),所有集成電路內(nèi)部輸出管的截止電流決定電阻R上的壓降。Vcc減去內(nèi)部管的總截止電流在電阻R上的壓降。就是輸出端Y的高電平輸出電壓值。如果輸出端外接負(fù)載門(mén),電阻上的壓降還要考慮負(fù)載電流,而負(fù)載電流的方向和大小由負(fù)載門(mén)的輸入特性決定。這就是下圖中電路中電阻阻值的技巧。

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